用于刷新半导体装置的存储器的设备的制作方法

本申请涉及半导体装置的技术领域，且尤其涉及存储器的技术领域。

背景技术：

动态随机存取存储器(dram)包含可用以存储数据的易失性存储器单元。然而，为了维持所存储的数据，周期性地刷新存储器单元以恢复正存储的数据。通常通过对与相应刷新地址相关联的存储器单元的群组进行定序来刷新存储器单元。可在内部产生刷新地址，且响应于刷新命令来执行对应于刷新地址的存储器单元的刷新操作。

刷新存储器单元会消耗功率。在低功率应用中，减少刷新操作的功率消耗可为有益的。因此，可具有减少的功率消耗的刷新操作可为合意的。

技术实现要素：

在一个方面中，提供一种设备。所述设备包括：存储器单元阵列；行锤击刷新电路，其经配置以基于所述存储器单元阵列的存取历史产生行锤击刷新地址；冗余电路，其经配置以存储所述存储器单元阵列的多个有缺陷地址；以及行预解码器，其经配置以当所述行锤击刷新地址匹配于所述多个有缺陷地址中的任一者时跳过所述行锤击刷新地址上的刷新操作。

在另一方面中，提供一种设备。所述设备包括：存储器单元阵列；行锤击刷新电路，其经配置以基于所述存储器单元阵列的存取历史产生行锤击刷新地址；锁存电路，其经配置以响应于刷新命令的第一次发生而锁存所述行锤击刷新地址；以及行预解码器，其经配置以响应于所述刷新命令的第二次发生而在所述行锤击刷新地址上执行刷新操作。

在再一方面中，提供一种设备。所述设备包括：存储器单元阵列，其包含常规阵列和冗余阵列；冗余电路，其包含多个存储器组，每一存储器组存储所述常规阵列中的有缺陷地址和指示所述存储器组经启用或未经启用的启用位，所述存储器组中的每一组具有不同的组地址；刷新计数器，其经配置以响应于刷新命令而更新刷新地址；以及行预解码器，其经配置以当所述刷新地址是针对所述常规阵列且不匹配于所述冗余电路中的所述存储器组中的任一组中存储的所述有缺陷地址时在所述刷新地址上执行刷新操作，且经配置以当所述刷新地址是针对所述冗余阵列时且当对应于所述刷新地址的所述存储器组未经启用时在所述刷新地址上跳过所述刷新操作。

附图说明

图1是根据本发明的实施例的设备的框图。

图2是根据本发明的实施例的存储器阵列的示意图。

图3是根据本发明的实施例的刷新控制电路的框图。

图4是根据本发明的实施例的掩蔽控制电路的框图。

图5是根据本发明的实施例的刷新操作的图。

图6是根据本发明的实施例的执行刷新操作的时序图。

图7是根据本发明的实施例的包含行锤击刷新操作的刷新操作的图。

图8是根据本发明的实施例的执行包含行锤击刷新操作的刷新操作的时序图。

图9是根据本发明的实施例的刷新控制电路的框图。

图10是根据本发明的实施例的就绪信号产生电路的电路图。

图11是根据本发明的实施例的冗余电路的框图。

图12是根据本发明的实施例的刷新操作的时序图。

图13和14是根据本发明的实施例的刷新操作的图。

具体实施方式

下文阐述某些细节以提供对本发明的实例的充分理解。然而，所属领域的技术人员将明白，可以在没有这些具体细节的情况下实践本发明的实例。此外，本文中所描述的本发明的特定实例不应解释为将本发明的范围限于这些特定实例。在其它情况下，尚未详细展示众所周知的电路、控制信号、时序协议和软件操作，以便避免不必要地混淆本发明的实例。另外，术语例如“耦合(couples、coupled)”意指两个组件可直接或间接电耦合。间接耦合可暗指两个组件通过一或多个中间组件耦合。

图1是根据本发明的实施例的设备的框图。所述设备可包含半导体装置100，且将如此提及。在一些实施例中，半导体装置100可包含(不限于)dram装置，举例来说例如集成到单个半导体芯片中的低功率ddr(lpddr)存储器。半导体装置100包含存储器阵列150。存储器阵列150包含多个排组，每一排组包含多个字线wl、多个位线bl和/bl，以及布置在所述多个字线wl与所述多个位线bl和/bl的相交点处的多个存储器单元mc。存储器单元mc是易失性存储器单元，其需要周期性刷新以便维持存储于存储器阵列中的数据。

字线wl的选择由行地址控制电路140执行，且位线bl的选择由列解码器145执行。感测放大器(samp)经定位以用于其对应的耦合到至少一个相应本地i/o线对(liot/b)的位线bl和/bl，所述至少一个相应本地i/o线对又经由充当开关的传输门(tg)耦合到至少一个相应主i/o线对(miot/b)。

如图2中所示出，存储器阵列150可包含常规阵列151和冗余阵列152。常规阵列151包含通常用以存储数据的存储器单元，其中存储器单元对应于相应存储器地址。冗余阵列152包含可用以“修复”常规阵列151的有缺陷的存储器单元的存储器单元。存储器单元可经配置为冗余存储器行和冗余存储器列。冗余存储器行可用以修复常规阵列151的存储器行，且冗余存储器列可用以修复常规阵列151的存储器列。通过使对应于缺陷存储器单元的存储器地址映射到冗余阵列152的存储器单元，冗余存储器用以修复常规阵列151的有缺陷的存储器单元。因此，当有缺陷的存储器位置的存储器地址提供到半导体装置100时，所述存储器地址映射到的冗余阵列152中的存储器位置被存取，而不是常规阵列151中对应于所述存储器地址的有缺陷的存储器位置。

在图2中展示的实例中，常规阵列151中包含的字线wl3、wla和wlc是有缺陷的，且这些字线分别被冗余阵列152中包含的辅助字线辅助字线rwl0、rwl1和rwl2代替。通过此配置，当请求对字线wl3的行存取时，选择辅助字线rwl0而不是字线wl3，且当请求对字线wla的行存取时，选择辅助字线rwl1而不是字线wla，且当请求对字线wlc的行存取时，选择辅助字线rwl2而不是字线wlc。同时，如稍后描述，在刷新操作中，不选择有缺陷的字线wl3、wla和wlc，且不执行作为这些有缺陷的字线的替代目标的字线rwl0、rwl1和rwl2上的任何代替刷新操作。当执行行锤击刷新操作时此特征是相同的。

在图2中展示的实例中，虽然包含字线rwl3的其它字线存在于冗余阵列152中，但这些字线未使用。对冗余阵列152中包含的未使用字线不指派任何有效逻辑地址，且因此在实际行存取中不选择这些未使用字线。而且当执行刷新操作时，不选择冗余阵列152中包含的未使用字线，且因此功率消耗减少。此外，在本实施例中，同样当执行行锤击刷新操作时，不选择冗余阵列152中包含的未使用字线。举例来说，即使当冗余阵列152中包含的字线rwl2和字线rwl3彼此物理上邻近且对字线rwl2的存取频率超过预定阈值时，在未使用字线rwl3上不执行任何行锤击刷新操作。另一方面，当冗余阵列152中包含的字线rwl1和字线rwl2彼此物理上邻近且当对字线rwl2的存取频率超过预定阈值时，在正使用的字线rwl1上执行行锤击刷新操作。

半导体装置100可采用多个外部端子，包含耦合到命令和地址总线以接收命令和地址的命令/地址端子ca。所述多个外部端子还包含用以接收时钟信号的时钟端子ck和/ck、数据端子dq和数据掩蔽端子dm，以及电源端子vdd、vss、vddq和vssq。

命令/地址端子ca可被供应例如来自存储器控制器的存储器地址。供应到命令/地址端子ca的存储器地址经由命令/地址输入电路105传送到地址解码器112。地址解码器112接收存储器地址且经由多路复用器113将经解码行地址xaddi供应到行地址控制电路140，且将经解码列地址yadd供应到列解码器145。

命令/地址端子ca可进一步被供应例如来自存储器控制器的命令。所述命令可作为内部命令信号icmd经由命令/地址输入电路105提供到命令解码器115。命令解码器115包含用以对内部命令icmd进行解码以产生用于执行操作的内部命令和信号的电路。举例来说，命令解码器115可将激活命令act提供到行地址控制电路140以选择字线，且可将读取/写入命令r/w提供到列解码器145以选择位线。当将执行刷新操作时，刷新命令aref可由命令解码器115提供到刷新控制电路200。激活命令act也可提供到刷新控制电路200。刷新命令aref可表示由半导体装置100接收到刷新命令引起的自动刷新命令。

当内部命令icmd指示自刷新进入时，命令解码器115激活自刷新进入命令sre，且当内部命令icmd指示自刷新退出时，命令解码器115激活自刷新退出命令srx。自刷新进入命令sre和自刷新退出命令srx供应到刷新控制电路200。当发出自刷新进入命令sre时，半导体装置100进入自刷新模式，且基于半导体装置100中产生的刷新地址执行自有效刷新操作。当发出自刷新退出命令srx时，半导体装置100从自刷新模式返回到正常操作模式。

当接收到读取命令且对存储器地址及时供应读取命令时，从存储器阵列150中由所述存储器地址标示的存储器单元mc读取读取数据。读取数据经由读取/写入放大器155和输入/输出电路160从数据端子dq输出到外部。当接收到写入命令且对存储器地址及时供应写入命令时，写入数据和数据掩蔽(在适用时)供应到数据端子dq和dm，且写入数据写入到存储器阵列150中由所述存储器地址标示的存储器单元mc。写入数据由输入/输出电路160中的数据接收器接收，且经由输入/输出电路160和读取/写入放大器155供应到存储器阵列150。

在用于读取和写入命令的存取操作期间，行地址控制电路140可包含用于确定存储器地址是否已映射到冗余阵列中的存储器位置的电路，举例来说，当对应于常规阵列中的有缺陷存储器位置的存储器地址已映射到冗余阵列的存储器位置(例如，冗余存储器行)时。存储已经重新映射的存储器地址，且将与存取操作相关联的存储器地址与存储的存储器地址进行比较。已经映射到冗余存储器的存储器地址可存储于非易失性存储装置中。非易失性存储装置的实例是以待存储的存储器地址编程的熔丝电路(以及反熔丝电路)。当与存取操作相关联的存储器地址匹配于存储的存储器地址时，存取冗余阵列中的存储器位置而不是常规阵列中的存储器位置。

如先前描述，周期性地刷新易失性存储器单元以便维持由存储器阵列存储的数据。存储器单元通常作为存储器单元行来刷新。行地址控制电路140可包含在刷新操作期间使用的刷新控制电路。当有效刷新命令aref提供到行地址控制电路140时执行刷新操作。每一刷新命令aref导致与刷新地址相关联的存储器位置被刷新。在本发明的一些实施例中，刷新地址可在半导体装置100中内部产生。在本发明的一些实施例中，列解码器145中可包含相似电路和操作。

刷新地址可具有与其相关联的若干存储器位置。举例来说，多个存储器行可与刷新地址相关联，其中所述存储器行中的每一者对应于当与刷新地址组合时会识别特定存储器行的值。此布置可促进较快的存取和刷新操作。

当刷新存储器时，确定刷新地址是否映射到冗余阵列中的冗余存储器位置。在刷新地址已映射到冗余存储器的情况下，不刷新常规阵列中对应于刷新地址的存储器位置，进而避免对未使用的存储器位置的不必要刷新操作，举例来说，当常规存储器位置是有缺陷的且对应存储器地址已映射到冗余存储器位置时。同样，例如当冗余存储器位置是有缺陷的或不具有映射到其的存储器地址时，也不刷新未使用的冗余存储器位置。与无论是否使用都对所有存储器位置执行刷新操作相比，跳过未使用的存储器位置的刷新操作可降低功耗。

如图1所示，行地址控制电路140中包含行锤击刷新电路142。行锤击刷新电路142分析对存储器阵列150的行存取的历史，且基于分析产生需要行锤击刷新操作的行地址。具体地，当对某一字线的行存取频率超过阈值时，产生物理上邻近于此字线的字线的行地址。通过此操作，关于物理上邻近于具有超出阈值的行存取频率的字线的字线，执行额外刷新操作。针对行地址必须执行行锤击刷新操作的原因在于，当行地址的频率超过阈值时，连接到邻近于具有超出阈值的行存取频率的字线的字线的存储器单元的信息保持特性降低。

转向半导体装置100中包含的外部端子的阐释，时钟端子ck和/ck被供应互补的外部时钟信号。外部时钟信号可供应到时钟输入电路120。时钟输入电路120可产生内部时钟信号iclk。内部时钟信号iclk供应到内部时钟产生器130和命令解码器115。当由来自命令/地址输入电路105的时钟启用cke启用时，内部时钟产生器130基于内部时钟信号iclk提供各种内部时钟信号lclk。内部时钟信号lclk可用于对各种内部电路的操作进行定时。举例来说，lclk信号可提供到输入/输出电路160以用于对输入/输出电路160的操作进行定时以在数据端子dq上提供和接收数据。

电源端子vdd和vss被供应电源电位。这些电源电位供应到内部电压产生器170。内部电压产生器170基于提供到电源端子vdd和vss的电源电位产生各种内部电位vpp、vod、vary、vperi及类似电位。内部电位vpp主要在行地址控制电路140中使用，内部电位vod和vary主要在存储器阵列150中包含的感测放大器samp中使用，且内部电位vperi在许多其它外围电路块中使用。

电源端子vddq和vssq也被供应电源电位。电源电位供应到输入/输出电路160。在本发明的一些实施例中，提供到电源端子vddq和vssq的电源电位可为与提供到电源端子vdd和vss的电源电位相同的电位。专用电源电位提供到电源端子vddq和vssq以使得由输入/输出电路160产生的电源噪声不传播到其它电路块。

图3是示出刷新控制电路200的配置的框图。如图3中所示，刷新控制电路200包含刷新状态控制电路210、刷新计数器220、rhr状态控制电路230和掩蔽控制电路240。刷新状态控制电路210接收命令aref、sre和srx，且产生刷新状态信号rfshi、自刷新状态信号sri和刷新计数信号refcnt。刷新状态信号rfshi是在其中执行刷新操作的周期期间激活的信号。自刷新状态信号sri是在其中半导体装置100处于自刷新模式的周期期间激活的信号。刷新计数信号refcnt是递增刷新计数器200的信号。刷新计数器220的计数值作为刷新地址refadd供应到多路复用器113。多路复用器113接收从外部输入的行地址xaddi和刷新地址refadd，当刷新状态信号rfshi处于非有效状态时选择从外部输入的行地址xaddi，且当刷新状态信号rfshi处于有效状态时选择刷新地址refadd。

rhr状态控制电路230接收激活命令act、预充电命令pre、刷新计数信号refcnt和自刷新状态信号sri，且产生行锤击刷新信号rhr。行锤击刷新信号rhr在其中执行行锤击刷新操作的周期期间激活。掩蔽控制电路240接收刷新地址refadd、刷新状态信号rfshi、自刷新状态信号sri和行锤击刷新信号rhr，且产生刷新状态信号rfsh。与刷新状态信号rfshi相反，刷新状态信号rfsh是在执行自刷新操作时已经历行锤击确定和片段掩蔽确定的信号。

图4是掩蔽控制电路240的电路图。如图4中所示，掩蔽控制电路240包含掩蔽区检测器241、“与”门电路242和244、“与非”门电路243和触发器电路225。掩蔽区检测器241是确定当前刷新地址refadd是否属于掩蔽区的电路。当执行自刷新操作时，在掩蔽区上不执行任何刷新操作，且因此掩蔽区中保持的数据丢失。当确定当前刷新地址refadd属于掩蔽区时，掩蔽区检测器241在高电平激活确定信号maskgo。确定信号maskgo、行锤击刷新信号rhr和自刷新状态信号sri输入到“与”门电路242。因此，当满足以下三个条件，即半导体装置100处于自刷新模式，其不在行锤击刷新操作中，以及当前刷新地址refadd属于掩蔽区时，在高电平激活掩蔽信号regmaskpre。同时，当半导体装置100处于行锤击刷新操作中时，不激活掩蔽信号regmaskpre。

掩蔽信号regmaskpre按原样供应到“与非”门电路243的输入节点中的一个，且经由触发器电路225供应到“与非”门电路243的其它输入节点。触发器电路225响应于通电信号pwrup且复位。刷新状态信号rfshi供应到触发器电路225的时钟节点。因此，在于高层级激活掩蔽信号regmaskpre之后，从“与非”门电路243输出的掩蔽信号regmaskf响应于下一刷新操作的开始定时，且在低电平被激活。当在低电平激活掩蔽信号regmaskf时，刷新状态信号rfshi由“与”门电路244掩蔽。另一方面，当掩蔽信号regmaskf处于高电平时，刷新状态信号rfshi和刷新状态信号rfsh具有相互相同的波形。以此方式，掩蔽控制电路240使用触发器电路225使执行片段掩蔽过程的定时延迟一个循环。稍后描述此过程的作用。

图5是根据本发明的实施例的刷新操作的图。在本发明的一些实施例中，图5的刷新操作可用以刷新图1的半导体装置100的存储器阵列150的存储器位置。

图5示出针对常规阵列的存储器位置和针对冗余阵列的存储器位置执行的刷新操作。在图5的实例中，通过刷新操作刷新的存储器位置与字线相关联。对于图5的实例，常规阵列中包含十六个字线(wl0-wlf)且冗余阵列中包含四个字线。在不脱离本发明范围的情况下常规和/或冗余阵列中可包含更多或更少的字线。

常规和冗余阵列中执行的每一刷新操作在图5中由黑竖直线表示。响应于刷新命令执行刷新操作。举例来说，参考图1的半导体装置100，刷新命令aref可由命令解码器115提供到行地址控制电路140。在刷新周期tref上针对常规阵列的存储器位置执行刷新操作，且随后是针对冗余阵列的存储器位置的刷新操作。在必要时重复针对常规阵列且接着针对冗余阵列的存储器位置的刷新。

跳过的刷新操作在图5中表示为较淡的竖直线。举例来说，在图5的实例中跳过用于常规阵列的字线wl3、wla和wlc的刷新操作。当例如对应于字线wl3、wla和wlc的存储器地址已经映射到冗余阵列中的存储器位置时，例如当常规阵列中对应于字线wl3、wla和wlc的存储器位置如参考图2所解释是有缺陷的时，可跳过字线wl3、wla和wlc。在图5的实例中，如参考图2所解释，wl3、wla和wlc分别映射到冗余阵列的rwl0、rwl1和rwl2。也可跳过冗余阵列的存储器位置的刷新操作。举例来说，跳过冗余阵列的字线rwl3的刷新操作。举例来说，当冗余阵列的字线wl3的存储器位置未使用(例如，00存储器地址映射到冗余阵列的字线wl3的存储器位置)时，可跳过冗余阵列的字线wl3。

例如当存储器位置是有缺陷的且对应存储器地址已经重新映射到冗余阵列的存储器位置和/或冗余阵列的存储器位置并不具有映射到其的存储器地址时，跳过未使用的存储器位置的刷新操作可通过避免对未使用的存储器位置的不必要刷新操作而降低功耗。

图6是根据本发明的实施例的执行刷新操作的时序图。在本发明的一些实施例中，图6的刷新操作可用以刷新图1的半导体装置100的存储器阵列150的存储器位置。

在时间t0，第一有效刷新命令(例如，有效高逻辑电平)致使输入刷新地址n且执行针对刷新地址n的刷新操作的准备。针对刷新操作的准备可包含例如确定与刷新地址n有关的刷新地址中的任一个是否匹配于存储于冗余电路中的存储器地址。存储的存储器地址可为重新映射到冗余存储器位置的存储器地址。可将与刷新地址n有关的刷新地址与存储的存储器地址进行比较以确定刷新地址中的任一个是否已映射到冗余阵列。同样在时间t0，响应于第一有效刷新命令，针对先前刷新地址，即刷新地址(n-1)执行刷新操作。针对刷新地址(n-1)的刷新操作以及刷新地址n的输入和针对刷新地址n的刷新操作的准备是在刷新时间trfc期间执行。在时间t1之前，第一有效刷新命令通过转变为低逻辑电平而变成非有效。

在时间t1，第二有效刷新命令致使输入刷新地址(n+1)且针对刷新地址(n+1)的刷新操作的准备开始。同样在时间t1，响应于第二有效刷新命令，针对在时间t0响应于第一有效刷新命令而输入的刷新地址n执行刷新操作。针对刷新地址n的刷新操作以及刷新地址(n+1)的输入和针对刷新地址(n+1)的刷新操作的准备是在时间t1后的刷新时间trfc期间执行。在时间t2之前，第二有效刷新命令通过转变为低逻辑电平而变成非有效。

在时间t2，第三有效刷新命令致使输入刷新地址(n+2)且针对刷新地址(n+2)的刷新操作的准备开始。同样在时间t2，响应于第三有效刷新命令，针对在时间t1响应于第二有效刷新命令而输入的刷新地址(n+1)执行刷新操作。第三有效刷新命令通过转变为低逻辑电平而变成非有效。

参考刷新地址n，输入刷新地址且在时间t0响应于第一有效刷新命令而准备刷新地址n的刷新操作并且接着在时间t1响应于第二有效刷新命令而执行刷新地址n的刷新操作允许在刷新时间trfc内完成针对刷新地址n的刷新操作。类似地，输入刷新地址且在时间t1响应于第二有效刷新命令而准备刷新地址(n+1)的刷新操作并且接着在时间t2响应于第三有效刷新命令而执行刷新地址(n+1)的刷新操作允许在刷新时间trfc内完成针对刷新地址(n+1)的刷新操作。

刷新时间trfc可能不足以输入刷新地址，准备刷新地址的刷新操作，且执行与刷新地址相关联的刷新操作。刷新时间trfc可具有由定时规范设定的最大时间。超出用于执行刷新地址的刷新操作的刷新时间trfc是不可接受的。

图7是用于阐释当正常刷新操作被行锤击刷新操作中断时的操作的时序图。在图7中展示的实例中，正常刷新操作被由附图标记201到203表示的三个行锤击刷新操作中断。常规阵列151的字线wl3(在图7中展示的实例中跳过)上的刷新操作和常规阵列151的字线wl4上的刷新操作被第一行锤击刷新操作201中断。如上文所描述，行锤击刷新操作是当对某一字线的行存取频率超过阈值时选择物理上邻近于此字线的字线且刷新所选择字线的操作。因此，在一个行锤击刷新操作中必须循序地选择两个字线。参考符号rhrad1表示在行锤击刷新操作中第一个选择的字线的地址，且参考符号rhrad2表示在行锤击刷新操作中第二个选择的字线的地址。具有超出阈值的行地址频率的字线经布置为由对应于地址rhrad1的字线和对应于地址rhrad2的字线包夹，且它们全部属于常规阵列151。在由附图标记201表示的实例中，对应于地址rhrad1的字线不具有任何缺陷且未被冗余阵列152替换，且因此执行对其的刷新操作。另一方面，对应于地址rhrad2的字线是有缺陷的且被冗余阵列152替换，且因此跳过刷新操作。因此，不必要的功率消耗减少。以此方式，在行锤击刷新操作中，当作为刷新目标的字线被冗余阵列152替换时，跳过在属于常规阵列151的替换起源的字线上的刷新操作。

冗余阵列152的字线rwl1上的刷新操作和冗余阵列152的字线rwl2上的刷新操作被第二行锤击刷新操作202中断。具有超出阈值的行地址频率的字线、对应于地址rhrad1的字线和对应于地址rhrad2的字线全部属于常规阵列151。以此方式，在其中对冗余阵列152执行正常刷新操作的周期期间，存在正常刷新操作被关于常规阵列151的行锤击刷新操作中断的情况。在由参考符号202表示的实例中，对应于地址rhrad2的字线没有缺陷且未被冗余阵列152替换，且因此对其执行刷新操作。另一方面，对应于地址rhrad1的字线是有缺陷的且已被冗余阵列152替换，且因此跳过对其的刷新操作。

常规阵列151的字线wla上的刷新操作和常规阵列151的字线wlb上的刷新操作被第三行锤击刷新操作203中断。具有超出阈值的行地址频率的字线、对应于地址rhrad1的字线和对应于地址rhrad2的字线全部属于冗余阵列152。以此方式，在其中对常规阵列151执行正常刷新操作的周期期间，存在正常刷新操作被关于冗余阵列152的行锤击刷新操作中断的情况。在由附图标记203表示的实例中，使用对应于地址rhrad1的字线且对其指派有效逻辑地址，且因此对其执行刷新操作。另一方面，不使用对应于地址rhrad2的字线且不对其指派任何有效逻辑地址，且因此跳过对其的刷新操作。以此方式，在行锤击刷新操作中，当作为刷新目标的字线在常规阵列151中未使用时，跳过对其的刷新操作。

图8是用于阐释刷新地址的输入定时与刷新操作的执行定时之间的关系的时序图。如图8中所示，在其中不执行任何行锤击刷新操作的周期期间，即在其中行锤击刷新信号rhr1和rhr2两者未激活的周期期间，每当发出刷新命令aref时更新刷新地址，选择对应于通过响应于先前刷新命令aref而输入的刷新地址的字线，且刷新连接到此字线的多个存储器单元的信息。另一方面，在其中执行行锤击刷新操作的周期期间，即在其中行锤击刷新信号rhr1和rhr2被激活的周期期间，停止已响应于刷新命令aref的刷新地址的更新，且选择需要行锤击刷新的字线。如上文所描述，在一个行锤击刷新操作中选择两个字线。在此实例中，当假设具有超出阈值的行存取频率的字线的地址是x时，一个行锤击刷新操作中选择的字线的地址是地址x+1和x-1。地址x+1对应于例如图7中示出的地址rhrad1，且地址x-1对应于例如图7中示出的地址rhrad2。

举例来说，在图8中示出的时间t10、t11、t12和t13中的每一个处发出刷新命令aref，且在时间t11和t12激活行锤击刷新信号rhr1和rhr2。在此情况下，在时间t10输入刷新地址<3>，且实际上在通过响应于先前发出的刷新命令aref而输入的刷新地址<2>上执行刷新操作。接下来，当在时间t11发出刷新命令aref时，实际上在刷新地址<3>上执行刷新操作。然而，此时，因为行锤击刷新信号rhr1和rhr2被激活，所以不执行刷新地址的更新且维持刷新地址<3>。此外，在时间t11，准备对应于行锤击刷新信号rhr1的刷新地址<x+1>。接下来，当在时间t12发出刷新命令aref时，实际上在刷新地址<x+1>上执行刷新操作。此时，因为行锤击刷新信号rhr1和rhr2被激活，所以不执行刷新地址的更新且维持刷新地址<3>。此外，在时间t12，准备对应于行锤击刷新信号rhr1的刷新地址<x-1>。接下来，当在时间t13发出刷新命令aref时，实际上在刷新地址<x-1>上执行刷新操作。此时，因为行锤击刷新信号rhr1和rhr2两者未激活，所以更新刷新地址为刷新地址<4>。

图9是根据本发明的实施例的刷新控制电路400。在本发明的一些实施例中，刷新控制电路400可包含于半导体装置100的行地址控制电路140中。

刷新控制电路400接收激活命令act、刷新状态信号rfsh和经解码行地址xadd。act命令、aref命令可由命令解码器(例如，半导体装置100的命令解码器115)提供。刷新状态信号rfsh可由刷新计数器电路200提供。

xadd地址提供到选择器电路440。选择器电路440基于行锤击刷新信号rhr1和rhr2选择xadd地址、第一行锤击刷新地址rhrad1和第二行锤击刷新地址rhrad2中的一个。当行锤击刷新信号rhr1和rhr2处于非有效状态时，选择器电路440选择且输出xadd地址到锁存电路420。当行锤击刷新信号rhr1处于有效状态时，选择器电路440选择且输出第一行锤击刷新地址rhrad1到锁存电路420。当行锤击刷新信号rhr2处于有效状态时，选择器电路440选择且输出第二行锤击刷新地址rhrad2到锁存电路420。锁存电路420响应于act命令而锁存xadd地址、第一行锤击刷新地址rhrad1或第二行锤击刷新地址rhrad2。锁存于锁存电路420中的地址作为rai地址提供到锁存电路432且提供到选择器电路422。锁存电路432响应于由振荡器电路434提供的count_end脉冲而锁存rai地址。闩锁的rai地址作为内部地址rairef提供到选择器电路412。选择器电路412选择将xadd或rairef地址提供到地址锁存器414。地址锁存器414响应于act命令而锁存来自选择器电路412的地址。锁存的地址提供到地址预解码器电路416。地址锁存器420、432和414是地址通过其传播到地址预解码器电路416的一系列锁存电路，且如将在下文更详细地描述，当接收到有效aref命令时提供用于准备刷新地址的刷新操作的定时，并且接着当接收到后续有效aref命令时执行(或跳过)对刷新地址的刷新操作。地址预解码器电路416基于由冗余电路424提供的冗余信息而控制针对由锁存电路414提供的刷新地址是执行还是跳过刷新操作。

扩展的1位添加到xadd地址。在本实施例中，在xadd<17:0>地址中，最高有效位xadd<17>是添加的位。xadd<17>地址指示对应地址是指派给常规阵列151还是冗余阵列152。当xadd<17>地址处于低电平时，其指示对应地址指派给常规阵列151，且当xadd<17>地址处于高电平时，其指示对应地址指派给冗余阵列152。此特征对于地址rai和地址rairef也是相同的。地址rai的最高有效位rai<17>输入到“与”门电路410。因此，在存取冗余阵列152时，在与刷新状态信号rfsh协调的同时激活rref_state信号。

振荡器电路434由刷新状态信号rfsh激活。当被激活时，振荡器电路434提供振荡输出信号ref_state_latch、count_end脉冲和振荡输出信号refclk。ref_state_latch信号的每六次振荡时由振荡器电路434提供有效count_end脉冲。refclk信号提供到计数器电路436，所述计数器电路提供计数ref<16,15,14>。在本发明的一些实施例中，ref<16,15,14>计数可为3位计数。然而，在本发明的其它实施例中，所述计数可包含更多或更少的位。因此，本发明的范围不受由计数器电路436提供的计数的特定位数目限制。ref<16,15,14>计数响应于振荡refclk信号而改变。举例来说，ref<16,15,14>计数可响应于振荡refclk信号而递增。在本发明的其它实施例中，ref<16,15,14>计数递减。在本发明的一些实施例中，ref<16,15,14>计数从000递增到101(即，从0递增到5)，然后返回到000以再次开始递增。因此，在本发明的此类实施例中，提供六个不同值作为ref<16,15,14>计数。ref<16,15,14>计数提供到选择器电路422。

选择器电路422针对act命令将raj<16:0>地址提供到冗余电路424，且针对aref命令组合ref<16,15,14>计数与rai地址并将组合地址提供到冗余电路424。冗余电路424将来自选择器电路422的地址与存储的存储器地址进行比较以确定来自选择器电路422的raj<16:0>地址是否匹配于存储的存储器地址中的一个。如先前描述，存储的存储器地址可为重新映射到冗余存储器位置的存储器地址。例如用于修复有缺陷的存储器位置的已映射到冗余存储器的存储器地址被存储且与传入的存储器地址进行比较以确定是存取原始存储器位置还是冗余存储器。在本发明的一些实施例中，存储的存储器地址由冗余电路424存储，而在本发明的其它实施例中，存储的存储器地址由可由冗余电路424存取的存储电路存储。冗余电路424提供冗余信息redai，其指示在由raj地址表示的当前刷新地址匹配存储存储器地址之间是否确定匹配。存储器地址可存储于非易失性存储电路中。举例来说，在本发明的一些实施例中，在熔丝电路(和/或反熔丝电路)中编程存储器地址。在本发明的一些实施例中，熔丝电路可包含于冗余电路424中。

raj<16:0>地址还供应到选择器411。选择器411接收raj<16:0>地址和熔丝数据efusedata<16:0>，响应于启用信号reduncken以将其中的一个设定为熔丝数据efusedatai<16:0>，且将熔丝数据efusedatai<16:0>供应到冗余电路424。启用信号reduncken由接收rref_state信号和就绪信号redunckready的“与”门电路413产生。“或非”门电路415接收启用信号reduncken和测试模式信号tmredundis，且停用信号redundisf作为从“或非”门电路415到冗余电路424的输出。测试模式信号tmredundis使正常冗余确定无效(无论其是否被替换)，且用于检查例如替换起源的地址。

图10是产生就绪信号redunckready的就绪信号产生电路450的电路图。如图10中所示，就绪信号产生电路450包含级联的触发器电路460到463。触发器电路460到463的输入节点和输出节点分别经由反相器470到473彼此连接。通过此配置，触发器电路460到463构成计数器且所述计数器的计数器值cnt<0>到cnt<2>供应到“与”门电路452。来自“与”门电路452的输出是就绪信号redunckready。时钟信号ckf从“或”门电路451供应到前部级上的触发器电路460。因为刷新状态信号rfsh和就绪信号redunckready供应到“或”门电路451，所以当就绪信号redunckready处于低电平时，在每当供应刷新状态信号rfsh时递增由触发器电路460到463构成的计数器的计数器值cnt<0>到cnt<2>。触发器电路460到463由复位信号rst复位。复位信号rst由接收复位信号efuserst和通电信号pwrupf的“与”门电路453产生。复位信号efuserst是用于其初始级处的熔丝加载操作的复位信号。通电信号pwrupf是在变为通电时由内部电源电路产生且供应的信号，且具有并不是根据接通或断开电力的状态而产生的可能性。因此，为了增加复位触发器电路460到463的准确性，使用复位信号efuserst和通电信号pwrupf两者。

首先，在变为通电之后的初始化操作中，当复位触发器电路460到463时，在低电平初始化所有计数器值cnt<0>到<2>。随后，每当供应刷新状态信号rfsh时递增这些计数器值，且当刷新状态信号rfsh被激活八次时，所有计数器值cnt<0>到cnt<2>经移位到高电平，且在高电平激活就绪信号redunckready。就绪信号redunckready用作在变为通电之后向冗余电路424指示熔丝加载操作的完成的信号。

冗余信息redai提供到选择器电路426且还提供到锁存电路438。锁存电路438响应于来自振荡器电路434的ref_state_latch信号锁存冗余信息redai以提供作为冗余旗标rsec。rsec旗标的状态指示冗余信息redai是否指示当前刷新地址与存储的存储器地址之间的匹配。rsec旗标提供到选择器电路426，所述选择器电路基于aref命令(由ref_state信号表示)将redai信号或rsec旗标提供到地址预解码器电路416。控制信号rref_state也提供到由“与”门电路410提供的地址预解码器电路416。rref_state信号指示由刷新地址计数器电路220提供的刷新地址是针对常规阵列还是冗余阵列的存储器位置。

地址预解码器电路416基于来自选择器电路426的冗余信息以及rref_state和ref_state信号提供激活信号以执行或跳过刷新常规阵列和冗余阵列中的存储器位置的刷新操作。

在存取操作期间，激活命令act提供到刷新控制电路400。当激活命令act处于有效(且刷新命令aref处于非有效)时，经解码行地址xadd<17:0>通过选择器电路412提供到锁存电路414。经解码行地址xadd<17:0>可由地址解码器(例如，半导体装置100的地址解码器112)提供。锁存电路414响应于有效act命令而锁存地址xadd<17:0>。锁存的xadd<17:0>地址作为内部地址raddilat提供到地址预解码器电路416。xadd<17:0>地址还提供到锁存电路420，所述锁存电路通过选择器电路440响应于有效act命令而锁存xadd<17:0>地址。锁存的xadd<17:0>地址作为内部地址rai由锁存电路420通过选择器电路422提供到冗余电路424。xadd<17:0>地址提供到冗余电路424(作为raj地址)以确定xadd<17:0>地址是否匹配于存储的存储器地址。如先前描述，例如用于修复有缺陷的存储器位置的已映射到冗余存储器的存储器地址被存储且与传入的存储器地址进行比较以确定是存取原始存储器位置还是冗余存储器。

如果冗余电路424确定raj地址不匹配于存储的存储器地址，那么指示未确定匹配的冗余信息redai通过选择器电路426提供到地址预解码器电路416。基于来自冗余电路424的指示未检测到匹配的冗余信息而存取由地址预解码器电路416提供的raddilat地址。然而，如果raj地址匹配于由冗余电路424存储的所存储存储器地址，那么指示确定匹配的冗余信息redai通过选择器电路426提供到地址预解码器电路416。冗余电路424还提供指示冗余存储器位置中的目的地地址的冗余地址redadd。基于来自冗余电路424的指示确定匹配的冗余信息而提供用于raj地址映射到的冗余存储器位置的冗余地址redadd以用于存取。

如图11中所示，冗余电路424包含地址保持电路504，所述地址保持电路包含多个存储器组set0到setn。存储器组set0到setn分别包含由常规阵列151中的有缺陷字线的地址defadd和启用位en构成的存储器单元505、解码器电路506、“异或非(exnor)”电路507和复合门电路508。地址defadd指示常规阵列151中作为替换起源的字线，且指派给对应存储器组的组地址指示冗余阵列中作为替换目标的字线。启用位en是指示是否使用对应存储器组的信息。因此，当启用位en处于非有效状态时，冗余阵列152中对应于存储器组的字线未使用。在图1中示出的熔丝阵列143中保持有缺陷的字线的地址defadd，且在变为通电之后在初始化操作中将地址defadd加载到地址保持电路504。用于将地址defadd从熔丝电路加载到地址保持电路504中的路径的一部分是用于将选择器411和冗余电路424彼此连接的路径。

当执行正常行存取时，在存储器组set0到setn当中其启用位en已经激活的存储器组中保持的raj地址和有缺陷地址defadd由“异或非”电路507进行比较。因此，当raj地址匹配于有缺陷地址defadd时，从“异或非”电路507的输出变成高电平。因此，只要停用信号redundisf未在低电平被激活，对应匹配信号match0到matchn就被激活。匹配信号match0到matchn供应到编码器电路502。当匹配信号match0到matchn中的任一个被激活时，编码器电路502激活冗余信息redai，且输出具有匹配的有缺陷地址defadd的存储器组的组地址redadd。此时，还在高电平激活信号redun。组地址redadd供应到地址预解码器电路416。通过此配置，选择由组地址redadd指示的冗余阵列152中的字线而不是由raj地址指示的常规阵列151中的字线。另一方面，当raj地址不匹配于有效存储器组中保持的任何有缺陷地址defadd时，冗余信息redai和信号redun处于非有效状态。因此，不执行对冗余阵列152的任何代替存取，且选择由raj地址指示的常规阵列151中的字线。

在刷新操作时，冗余电路424的操作根据rref_state信号是否指示冗余阵列152上的刷新操作而不同。即，冗余电路424的操作根据刷新操作的目标是常规阵列151还是冗余阵列152而不同。首先，当rref_state信号未激活时，即当刷新操作的目标是常规阵列151时，存储器组set0到setn当中其启用位en已经激活的存储器组中保持的raj地址和有缺陷地址defadd由“异或非”电路507进行比较。因此，当raj地址不匹配于有效存储器组中保持的任何有缺陷地址defadd时，冗余信息redai处于非有效状态。在此情况下，选择常规阵列151中由raj地址指示的字线，且刷新对应于所述字线的存储器单元的信息。另一方面，当raj地址匹配于有效存储器组中保持的任何有缺陷地址defadd时，激活冗余信息redai。因此，跳过raj地址上的刷新操作。

同时，当rref_state信号激活时，即当刷新操作的目标是冗余阵列152时，启用信号reduncken变成高电平，且停用信号redundisf经移位到低电平。因此，“异或非”电路507的比较结果失效，且解码器电路506变成有效。随后，读取基于熔丝数据efusedatai<16:0>而选择的存储器组的启用位en且经由复合门电路508供应到编码器电路502。因此，当对应存储器组的启用位en激活时，即当使用冗余阵列152中对应于所述存储器组的字线时，冗余信息redai被设定为处于非有效状态。在此情况下，选择冗余阵列152中由raj地址指示的字线，且刷新对应于所述字线的存储器单元的信息。另一方面，当对应存储器组的启用位en未激活时，即当冗余阵列152中对应于存储器组的字线未使用时，激活冗余信息redai。因此，跳过raj地址上的刷新操作。

在本实施例中，正常区域地址的冗余确定(其是否被替换)和冗余区域地址的冗余确定(其是否使用)由冗余电路424执行。因此，如果以简单方式设计到冗余电路424的路径，那么解码器电路506的负载添加在所述路径上，且在每当发出有效命令时以大负载驱动路径变成必要的。在此情况下，毫无疑问半导体装置100的速度和功率两者都降级。因此，在本实施例中，用于正常区域地址的冗余确定(其是否被替换)的路径和用于冗余区域地址的冗余确定(其是否使用)的路径彼此分隔开。此外，不必新添加用于冗余区域地址的冗余确定(其是否使用)的路径，且再使用为了从图1中示出的熔丝阵列143加载熔丝数据而提供的路径144。用于加载熔丝数据的路径是用于将图9中示出的选择器411和冗余电路424彼此连接的路径。通过此配置，有可能减少用于正常区域地址的冗余确定的路径上的负载，而不需要新添加用于冗余区域地址的冗余确定(其是否使用)的路径。

在刷新操作时冗余电路424的操作与正常刷新操作和行锤击刷新操作相同。因此，当常规阵列151中作为行锤击刷新操作的目标的字线是有缺陷的且被冗余阵列152中的字线替换时，跳过对其的刷新操作。此外，还当冗余阵列152中作为行锤击刷新操作的目标的字线未使用时，跳过对其的刷新操作。因此，由于不必要的刷新操作带来的功率消耗减少。

返回参看图9，刷新控制电路400包含行锤击刷新电路142。行锤击刷新电路142包含取样电路441和计算器442。取样电路441通过对从锁存电路414输出的内部地址raddilat和冗余地址redadd进行取样来分析对存储器阵列的行存取的历史。指示xadd地址是否已被替换的信号redun也输入到取样电路441。即，由取样电路441分析的地址是已经历冗余确定的地址，且基于信号redun确定是对在冗余确定之前的地址raddilat进行取样还是对已转换成冗余区的地址的冗余地址redadd进行取样。当响应于有效命令的xadd地址经替换时，对已转换成冗余区的地址的冗余地址redadd进行取样。因此，即使在正常区与冗余区之间的边界区中，也可正确地执行邻近地址的计算。

当对某一字线的行存取频率超过阈值时，取样电路441循序地激活行锤击刷新信号rhr1和rhr2。在选择邻近于具有超出阈值的行存取频率的字线的一侧的字线时激活行锤击刷新信号rhr1。在选择邻近于具有超出阈值的行存取频率的字线的另一侧的字线时激活行锤击刷新信号rhr2。在当激活行锤击刷新信号rhr1时取样电路441产生第一行锤击刷新地址rhrad1。第一行锤击刷新地址rhrad1具有通过反转具有超出阈值的行地址频率的字线的地址的最低有效位而获得的值。在当激活行锤击刷新信号rhr2时计算器442产生第二行锤击刷新地址rhrad2。第二行锤击刷新地址rhrad2的值由计算器442计算。

行锤击刷新信号rhr1和rhr2供应到选择器电路440。当激活行锤击刷新信号rhr1时，选择器电路440选择第一行锤击刷新地址rhrad1，且当激活行锤击刷新信号rhr2时，选择器电路440选择第二行锤击刷新地址rhrad2。

首先，当取样电路441检测到对某一字线的行存取频率已超过阈值的事实时，取样电路441响应于刷新命令aref以激活行锤击刷新信号rhr1，且产生第一行锤击刷新地址rhrad1。第一行锤击刷新地址rhrad1经由选择器电路440锁存于锁存电路420中。锁存于锁存电路420中的第一行锤击刷新地址rhrad1经由选择器电路422供应到冗余电路424。通过执行上文描述的操作，冗余电路424执行或跳过对应于第一行锤击刷新地址rhrad1的刷新操作。第一行锤击刷新地址rhrad1经由锁存电路432反馈到计算器442，且第二行锤击刷新地址rhrad2由计算器442计算。

当再次激活刷新命令aref时，取样电路441去活行锤击刷新信号rhr1且激活行锤击刷新信号rhr2。由计算器442计算的第二行锤击刷新地址rhrad2经由选择器电路440锁存于锁存电路420中。锁存于锁存电路420中的第二行锤击刷新地址rhrad2经由选择器电路422供应到冗余电路424。通过执行上文描述的操作，冗余电路424执行或跳过对应于第二行锤击刷新地址rhrad2的刷新操作。随后，去活行锤击刷新信号rhr2且完成一系列行锤击刷新操作。

将参考图12描述用于刷新操作的刷新控制电路400的操作。图12是根据本发明的实施例的用于刷新操作的时序图。在本发明的一些实施例中，图12的刷新操作可受图9的刷新控制电路400控制。

图12说明提供到刷新控制电路400的有效刷新命令(例如，aref)、由计数器电路436提供的ref<16>、ref<15>和ref<14>地址、由振荡器电路434提供的ref_state_latch信号，和由锁存电路438提供的rsec旗标。由“与”门电路410提供的rref_state信号是第一逻辑电平，向地址预解码器电路416指示所提供的刷新地址是针对常规阵列的存储器位置。

在时间t0，第一有效刷新命令致使输入刷新地址n。刷新地址n由刷新地址计数器电路220提供以由锁存电路420锁存。刷新地址n由锁存电路420提供到选择器电路422作为rai地址。第一有效刷新命令还启用振荡器电路434以将refclk信号提供到计数器电路436且将ref_state_latch信号提供到锁存电路438。

如先前参考图9描述，refclk信号是振荡信号，其致使计数器电路436将3位计数ref<16,15,14>从000递增到101(即，从0到5)，然后返回到000以再次开始递增。图12中示出递增ref<16>、ref<15>和ref<14>计数，从000递增经过001、010、011、100和101，然后返回到000。ref<16,15,14>计数提供到选择器电路422以与来自锁存电路420的锁存刷新地址(作为rai地址提供)的14位组合以提供17位刷新地址。举例来说，rai<13:0>(14位)通过选择器电路422与ref<16,15,14>计数组合以用于刷新操作而提供17位刷新地址。将ref<16,15,14>计数从000递增到101提供与由刷新地址计数器电路220提供的一个14位刷新地址有关的六个不同的17位刷新地址。

来自选择器电路422的17位刷新地址提供到冗余电路424，所述冗余电路将17位刷新地址与由冗余电路424存储的存储器地址进行比较。冗余电路424提供具有逻辑值的冗余信息，所述逻辑值指示当前17位刷新地址与存储的存储器地址之间是否存在匹配。举例来说，冗余电路424当在当前17位刷新地址与存储的存储器地址之间存在匹配时提供高逻辑电平冗余信息，且当不存在匹配时提供低逻辑电平冗余信息。随着ref<16,15,14>计数改变，每一新的所得17位刷新地址提供到冗余电路424且由其进行比较以提供用于每一17位刷新地址的相应冗余信息。以此方式，提供到冗余电路424的刷新地址被逐个地确定其是否匹配于存储的存储器地址(例如，对应于有缺陷的存储器且已映射到冗余存储器)。

冗余信息由锁存电路438响应于ref_state_latch信号而锁存，所述信号是由经启用振荡器电路434提供的振荡信号。振荡ref_state_latch信号在图12中示出且ref_state_latch信号的正脉冲由对应于ref<16,15,14>计数的值识别(例如，<0>、<1>、<2>、<3>、<4>和<5>。因此，锁存电路438锁存提供到冗余电路424的每一不同17位刷新地址的冗余信息。锁存电路438将用于每一17位刷新地址的锁存冗余信息作为rsec旗标通过选择器电路426提供到地址预解码器电路416。

在图12的实例中，用于[刷新地址n+000的ref<16,15,14>]的17位刷新地址由冗余电路424确定匹配存储的存储器地址，如由对应于ref_state_latch的脉冲<0>的高逻辑电平rsec旗标指示。ref<16,15,14>计数响应于由振荡器电路434提供的refclk信号而递增到001以提供新刷新地址供冗余电路424进行比较。用于[刷新地址n+001的ref<16,15,14>]的17位刷新地址由冗余电路424确定不匹配存储的存储器地址，如由对应于ref_state_latch的脉冲<1>的低逻辑电平rsec旗标指示。ref<16,15,14>计数再次响应于refclk信号递增到010以将新刷新地址提供到冗余电路424。用于[刷新地址n+010的ref<16,15,14>]的17位刷新地址由冗余电路424确定匹配存储的存储器地址，如由对应于ref_state_latch的脉冲<2>的高逻辑电平rsec旗标指示。ref<16,15,14>计数的递增以及通过冗余电路424对所得17位地址与存储的存储器地址的比较针对刷新地址[刷新地址n+011的ref<16,15,14>]、[刷新地址n+100的ref<16,15,14>]和[刷新地址n+101的ref<16,15,14>]继续。

总之对于图12的实例，刷新地址[刷新地址n+000的ref<16,15,14>]和[刷新地址n+010的ref<16,15,14>]由冗余电路424确定匹配于存储的存储器地址，而刷新地址[刷新地址n+001的ref<16,15,14>]、[刷新地址n+011的ref<16,15,14>]、[刷新地址n+100的ref<16,15,14>]和[刷新地址n+101的ref<16,15,14>]由冗余电路424确定不匹配于任何存储的存储器地址。

如先前描述，用于刷新地址的对应rsec旗标提供到地址预解码器电路416。地址预解码器电路416基于rsec旗标而控制针对由锁存电路414提供的刷新地址是执行还是跳过刷新操作。举例来说，当rsec旗标是低逻辑电平(例如，不存在匹配)时地址预解码器电路416致使针对由锁存电路414提供的刷新地址执行刷新操作。相比之下，当rsec旗标是高逻辑电平(例如，存在匹配)时地址预解码器电路416致使针对由锁存电路414提供的刷新地址跳过刷新操作。以此方式，对应于从由锁存电路414提供的刷新地址与ref<16,15,14>计数的组合产生的刷新地址的存储器位置在它们被使用时(例如，刷新地址不匹配于存储的存储器地址)被刷新，但在所述存储器位置未使用时(例如，存储器位置是有缺陷的且对应于有缺陷的存储器位置的存储器地址映射到冗余存储器中的存储器位置)不刷新。

还如先前描述，在refclk信号(或ref_state_latch信号)的每六个振荡时振荡器电路434将正count_end脉冲提供到锁存电路432。count_end脉冲致使锁存电路432锁存rai地址(例如，来自刷新地址计数器电路220的当前刷新地址)且通过选择器电路412将锁存的刷新地址提供到锁存电路414。

在图12的实例中，振荡器电路434在时间t1的后续有效刷新命令之前提供count_end脉冲(未图示)以致使锁存电路432锁存刷新地址n(由锁存电路420提供为rai地址)且通过选择器电路412将锁存的刷新地址n提供到锁存电路414。举例来说，在本发明的一些实施例中，在提供到计数器电路436的refclk信号的第六脉冲处提供count_end脉冲。因此，可由振荡器电路434提供对应于当ref<16,15,14>计数即将从101滚动到000时的count_end脉冲。在本发明的其它实施例中，可在刷新地址n已由锁存电路420锁存之后且在时间t1的后续有效刷新命令之前的不同时间提供count_end脉冲。

总之，在时间t0之后且在时间t1之前，从刷新地址n与ref<16,15,14>计数的组合产生的六个刷新地址已通过冗余电路424与存储的存储器地址进行比较，以提供与刷新地址n相关联的六个刷新地址中的每一个的冗余信息。与刷新地址n相关联的六个刷新地址中的每一个的冗余信息且循序地由锁存电路438锁存并提供到地址预解码器电路416作为六个rsec旗标。另外，刷新地址n由锁存电路432锁存且提供到锁存电路414，且第一有效刷新命令变成非有效。

在时间t1，提供第二有效刷新命令。第二有效刷新命令致使锁存电路414锁存刷新地址n(由锁存电路432通过选择器电路412提供)且将锁存的刷新地址n提供到地址预解码器电路416。基于用于与在时间t0与t1之间提供到地址预解码器电路416的刷新地址n相关联的六个地址的rsec旗标，地址预解码器电路416致使针对具有低逻辑电平rsec旗标的刷新地址执行刷新操作且致使针对具有高逻辑rsec旗标的刷新地址跳过刷新操作。以此方式，在完成用于刷新操作的准备(例如，时间t0与t1之间的准备)之后执行与刷新地址n相关联的刷新地址的刷新操作，且可在时间t1与t2之间执行刷新操作。另外，跳过对应于未使用的存储器位置(例如，已经重新映射到冗余存储器的有缺陷的存储器位置)的刷新地址的刷新操作。在图12的实例中，执行刷新地址[刷新地址n+001的ref<16,15,14>]和[刷新地址n+011的ref<16,15,14>]至[刷新地址n+101的ref<16,15,14>]的刷新操作，且跳过刷新地址[刷新地址n+000的ref<16,15,14>]和[刷新地址n+010的ref<16,15,14>]的刷新操作。

在本发明的一些实施例中，同时执行(未跳过的)刷新地址的存储器位置的刷新操作。举例来说，同时执行刷新地址[刷新地址n+001的ref<16,15,14>]和[刷新地址n+011的ref<16,15,14>]至[刷新地址n+101的ref<16,15,14>]的存储器位置。在本发明的一些实施例中，循序地执行(未跳过的)刷新地址的存储器位置。举例来说，刷新刷新地址[刷新地址n+001的ref<16,15,14>]的存储器位置，并且接着刷新刷新地址[刷新地址n+011的ref<16,15,14>]的存储器位置，并且接着刷新刷新地址[刷新地址n+100的ref<16,15,14>]的存储器位置，等等。在本发明的一些实施例中，(未跳过的)刷新地址的存储器位置的刷新操作在不同时间开始，但重叠。刷新地址的存储器位置与基本刷新地址相关的方式并不希望限制本发明的范围。

同样在时间t1，第二有效刷新命令致使刷新地址计数器电路220提供刷新地址(n+1)来输入。先前针对刷新地址n描述的在时间t0与t1之间执行的刷新操作的准备针对时间t1与t2之间的刷新地址(n+1)重复。举例来说，在时间t1与t2之间，从刷新地址(n+1)与ref<16,15,14>计数的组合产生的六个刷新地址由冗余电路424与存储的存储器地址进行比较，以提供与刷新地址(n+1)相关联的六个刷新地址中的每一个的冗余信息。与刷新地址(n+1)相关联的六个刷新地址中的每一个的冗余信息由锁存电路438循序地锁存且提供到地址预解码器电路416作为六个rsec旗标。另外，刷新地址(n+1)由锁存电路432锁存且提供到锁存电路414，且第二有效刷新命令变成非有效。在图12的实例中，刷新地址[刷新地址(n+1)+001的ref<16,15,14>]由冗余电路424确定匹配于存储的存储器地址(如由对应于ref_state_latch的脉冲<1>的高逻辑电平rsec信号指示)，而刷新地址[刷新地址(n+1)+000的ref<16,15,14>]和[刷新地址(n+1)+010的ref<16,15,14>]至[刷新地址(n+1)+101的ref<16,15,14>]由冗余电路424确定不匹配于任何存储的存储器地址(如由对应于ref_state_latch的脉冲<0>和<1>至<5>的低逻辑电平rsec信号指示)。

在时间t2，第三有效刷新命令致使锁存电路414锁存刷新地址(n+1)(由锁存电路432通过选择器电路412提供)且将锁存的刷新地址(n+1)提供到地址预解码器电路416。基于与在时间t1与t2之间提供到地址预解码器电路416的刷新地址(n+1)相关联的六个地址的rsec旗标，地址预解码器电路416致使针对具有低逻辑电平rsec旗标的刷新地址执行刷新操作且致使针对具有高逻辑rsec旗标的刷新地址跳过刷新操作。以此方式，在完成刷新操作的准备(例如，在时间t1与t2之间的准备)之后执行与刷新地址(n+1)相关联的刷新地址的刷新操作，且可在时间t2与t3之间执行刷新操作。另外，跳过对应于未使用的存储器位置(例如，已经重新映射到冗余存储器的有缺陷的存储器位置)的刷新地址的刷新操作。在图12的实例中，执行刷新地址[刷新地址(n+1)+000的ref<16,15,14>]和[刷新地址(n+1)+010的ref<16,15,14>]至[刷新地址(n+1)+101的ref<16,15,14>]的刷新操作，且跳过刷新地址[刷新地址(n+1)+001的ref<16,15,14>]的刷新操作。

同样在时间t2，第三有效刷新命令致使刷新地址计数器电路220提供刷新地址(n+2)来输入。先前针对刷新地址n和(n+1)描述的在时间t0与t1之间和在时间t1与t2之间执行的刷新操作的准备是针对在时间t2后的刷新地址(n+2)重复，而预期在完成准备之后执行与刷新地址(n+2)相关联的刷新地址的刷新操作。可响应于后续有效刷新命令而执行与刷新地址(n+2)相关联的刷新地址的刷新操作。

在常规阵列的存储器位置的刷新操作后，执行冗余阵列的存储器位置的刷新操作，如先前参考图5描述。来自“与”门电路410的rref_state信号改变为第二逻辑电平，向地址预解码器电路416指示所提供的刷新地址是针对冗余阵列的存储器位置。用于冗余阵列的存储器位置的刷新操作的刷新控制电路400的操作类似于针对常规阵列的存储器位置的刷新操作描述的操作。因此，跳过冗余阵列的未使用的存储器位置的刷新操作，同时执行冗余阵列的使用的存储器位置(例如，具有映射到其的存储器地址)的刷新操作。

图13是用于阐释片段掩蔽操作的时序图。图13中示出的刷新状态信号rfsh_a是根据当未使用触发器电路225时获得的比较实例的刷新状态信号rfsh的波形。在刷新状态信号rfshi、rfsh_a和rfsh当中，由白色箭头指示的信号是对应于在掩蔽区之前的边缘地址的刷新状态信号。如图13中所示，当半导体装置100进入自刷新模式时，每当在高电平激活确定信号maskgo时掩蔽刷新状态信号rfsh。在比较实例中未使用触发器电路225的情况下，恰好在高电平激活确定信号maskgo之后掩蔽刷新状态信号rfsh，且因此在确定信号maskgo经移位到低电平之前不刷新掩蔽区之前的边缘地址，且刷新周期变长。另一方面，在本实施例中，触发器电路225提供于掩蔽控制电路240中，且由于在高电平激活确定信号maskgo而在一个循环之后执行片段掩蔽过程。因此，迅速地刷新在掩蔽区之前的边缘地址。

图14是用于阐释在半导体装置100进入自刷新模式且行锤击刷新信号rhr被激活的时间点掩蔽区中包含刷新地址的情况下的操作的时序图。在刷新状态信号rfsh当中，由白色箭头指示的信号是对应于在掩蔽区之前的边缘地址的刷新状态信号。在刷新状态信号rfsh当中，由条纹箭头指示的信号是对应于行锤击刷新操作的刷新状态信号。当激活行锤击刷新信号rhr时，停止刷新计数器220的递增操作且临时停止刷新状态信号rfsh的掩蔽操作。因此，如图14中所示在半导体装置100进入自刷新模式且行锤击刷新信号rhr被激活的时间点掩蔽区中包含刷新地址的情况下，由于在高电平激活确定信号maskgo而在三个循环之后执行片段掩模过程。因此，迅速地刷新在掩蔽区之前的边缘地址，且在无地址经掩蔽的情况下正确地执行行锤击刷新操作。

如针对本发明的各种实施例所描述，可逐个地确定刷新地址映射到冗余存储器(例如，当常规阵列中的对应存储器位置是有缺陷的时)，且可跳过常规阵列和冗余阵列的未使用的存储器位置(例如，有缺陷的且具有重新映射到冗余存储器的对应存储器地址)的刷新操作，同时执行常规阵列和冗余阵列的使用的存储器位置的刷新操作。因此，可避免对未使用的存储器位置的不必要的刷新操作。

从前述内容应了解，尽管本文中已出于说明的目的描述了本发明的具体实施例，但可以在不脱离本发明的精神和范围的情况下进行各种修改。因此，本发明的范围不应受到本文中描述的具体实施例中的任一个限制。

技术特征：

1.一种设备，其包括：

存储器单元阵列；

行锤击刷新电路，其经配置以基于所述存储器单元阵列的存取历史产生行锤击刷新地址；

冗余电路，其经配置以存储所述存储器单元阵列的多个有缺陷地址；以及

行预解码器，其经配置以当所述行锤击刷新地址匹配于所述多个有缺陷地址中的任一者时跳过所述行锤击刷新地址上的刷新操作。

2.根据权利要求1所述的设备，

其中所述冗余电路经配置以响应于第一刷新命令将所述行锤击刷新地址与所述多个有缺陷地址进行比较，且

其中所述行预解码器经配置以当所述行锤击刷新地址不匹配于所述多个有缺陷地址中的任一者时响应于第二刷新命令而在所述行锤击刷新地址上执行所述刷新操作。

3.根据权利要求2所述的设备，

其中所述存储器单元阵列包含常规阵列和冗余阵列，且

其中存储于所述冗余电路中的所述多个有缺陷地址经指派于所述常规阵列。

4.根据权利要求3所述的设备，其中所述行预解码器经配置以当所述行锤击刷新地址指示所述冗余阵列中的有效地址时在所述行锤击刷新地址上执行所述刷新操作。

5.根据权利要求4所述的设备，其中所述行预解码器经配置以当所述行锤击刷新地址指示所述冗余阵列中的未使用地址时在所述行锤击刷新地址上跳过所述刷新操作。

6.根据权利要求5所述的设备，

其中所述冗余电路包含多个存储器组，所述存储器组中的每一组存储所述常规阵列中的有缺陷地址和指示所述存储器组经启用或未经启用的启用位，且

其中所述冗余电路经配置以当所述行锤击刷新地址是针对所述常规阵列时将所述行锤击刷新地址与所述存储器组中的每一组中的所述有缺陷地址进行比较。

7.根据权利要求6所述的设备，

其中所述冗余电路中的所述存储器组中的每一组具有不同的组地址，且

其中所述冗余电路进一步包含将针对所述冗余阵列的所述行锤击刷新地址转换为行锤击刷新组地址的解码器，所述冗余电路经配置以决定经指派于组地址匹配于所述行锤击刷新组地址的所述存储器组的所述启用位被激活或未被激活。

8.根据权利要求1所述的设备，其进一步包括经配置以响应于刷新命令而更新刷新地址的刷新计数器，

其中所述行锤击刷新电路经配置以停止更新所述刷新计数器中的所述刷新地址直到行锤击刷新操作完成为止。

9.一种设备，其包括：

存储器单元阵列；

行锤击刷新电路，其经配置以基于所述存储器单元阵列的存取历史产生行锤击刷新地址；

锁存电路，其经配置以响应于刷新命令的第一次发生而锁存所述行锤击刷新地址；以及

行预解码器，其经配置以响应于所述刷新命令的第二次发生而在所述行锤击刷新地址上执行刷新操作。

10.根据权利要求9所述的设备，

其中所述存储器单元阵列包含常规阵列和冗余阵列，

其中所述常规阵列包含正常存储器单元和有缺陷存储器单元，且

其中所述行预解码器经配置以当所述行锤击刷新地址是针对所述常规阵列中的所述正常存储器单元时在所述行锤击刷新地址上执行所述刷新操作。

11.根据权利要求10所述的设备，其中所述行预解码器经配置以当所述行锤击刷新地址是针对所述常规阵列中的所述有缺陷存储器单元时在所述行锤击刷新地址上跳过所述刷新操作。

12.根据权利要求11所述的设备，

其中所述冗余阵列包含代替所述常规阵列中的所述有缺陷存储器单元的所使用存储器单元以及未使用存储器单元，且

其中所述行预解码器经配置以当所述行锤击刷新地址是针对所述冗余阵列中的所述所使用存储器单元时在所述行锤击刷新地址上执行所述刷新操作。

13.根据权利要求12所述的设备，其中所述行预解码器经配置以当所述行锤击刷新地址是针对所述冗余阵列中的所述未使用存储器单元时在所述行锤击刷新地址上跳过所述刷新操作。

14.根据权利要求9所述的设备，其进一步包括经配置以响应于所述刷新命令而更新刷新地址的刷新计数器，

其中所述行锤击刷新电路经配置以停止更新所述刷新计数器中的所述刷新地址直到行锤击刷新操作完成为止。

15.根据权利要求14所述的设备，

其中所述锁存电路经配置以响应于所述刷新命令的所述第二次发生而锁存所述刷新地址；且

其中所述行预解码器经配置以响应于所述刷新命令的第三次发生而在所述刷新地址上执行所述刷新操作。

16.一种设备，其包括：

存储器单元阵列，其包含常规阵列和冗余阵列；

冗余电路，其包含多个存储器组，每一存储器组存储所述常规阵列中的有缺陷地址和指示所述存储器组经启用或未经启用的启用位，所述存储器组中的每一组具有不同的组地址；

刷新计数器，其经配置以响应于刷新命令而更新刷新地址；以及

行预解码器，其经配置以当所述刷新地址是针对所述常规阵列且不匹配于所述冗余电路中的所述存储器组中的任一组中存储的所述有缺陷地址时在所述刷新地址上执行刷新操作，且经配置以当所述刷新地址是针对所述冗余阵列时且当对应于所述刷新地址的所述存储器组未经启用时在所述刷新地址上跳过所述刷新操作。

17.根据权利要求16所述的设备，其中所述行预解码器经配置以当所述刷新地址是针对所述常规阵列且匹配于所述冗余电路中的所述存储器组中的任一组中存储的所述有缺陷地址时在所述刷新地址上跳过所述刷新操作。

18.根据权利要求17所述的设备，其中所述行预解码器经配置以当所述刷新地址是针对所述冗余阵列时且当对应于所述刷新地址的所述存储器组经启用时在所述刷新地址上执行所述刷新操作。

19.根据权利要求18所述的设备，其进一步包括：

行锤击刷新电路，其经配置以基于所述存储器单元阵列的存取历史产生行锤击刷新地址；以及

选择器，其经配置以将从所述刷新计数器供应的所述刷新地址和从所述行锤击刷新电路供应的所述行锤击刷新地址中的一个供应到所述冗余电路。

20.根据权利要求19所述的设备，其中所述行锤击刷新电路经配置以停止更新所述刷新计数器中的所述刷新地址直到行锤击刷新操作完成为止。

技术总结

本申请涉及用于刷新半导体装置的存储器的设备。本文揭示一种设备，其包含：存储器单元阵列；行锤击刷新电路，其经配置以基于所述存储器单元阵列的存取历史产生行锤击刷新地址；冗余电路，其经配置以存储所述存储器单元阵列的多个有缺陷地址；以及行预解码器，其经配置以当所述行锤击刷新地址匹配于所述多个有缺陷地址中的任一者时在所述行锤击刷新地址上跳过刷新操作。

技术研发人员：伊藤丰;持田义史;荒木宏卫

受保护的技术使用者：美光科技公司

技术研发日：.08.12

技术公布日：.02.21